本文作者：代国宪；陈迟晓；叶凡；任俊彦；成功正常投稿发表论文到《复旦学报(自然科学版)》2014年04期,引用请注明来源400期刊网！
【摘要】：设计了一种高速的逐次逼近型模数转换器(SuccessiveApproximatedRegisterAnalog-DigitalConverter,SARADC),与传统SARADC相比,该ADC除了采样电容阵列,额外使用了一个辅助数模转换器(AuxiliaryDigital-AnalogConverter,AUX-DAC)来实现2-bit/cycle.系统设计的SARADC使用了一个共享的内插预放大器,可以将输入信号和比较器隔离开,减小了比较器的回踢噪声.为了进一步提高转换速度,采用比较器交替工作模式,其输出结果直接送给电容阵列进行处理,与传统SARADC相比大大减小了逻辑延时.由于架构中使用了多路比较器,因此采用前台校准技术用来校正比较器的失调电压.后仿结果表明该ADC在400M采样速率和1.2V的电源电压下,可以实现48dB的SNDR,功耗为5.6mW,优值FoM为67fJ/conversion-step.
【论文正文预览】：在各类模数转换器(Analog-DigitalConverter,ADC)中,逐次逼近型(SuccessiveApproximatedRegister,SAR)结构具有高能效的优势.但是与快闪型、折叠内插型和流水线型模数转换器相比,其转换速度相对慢一些,这是因为SARADC需要N+1的转换周期才能得到N-bit的数据.限制SARADC工作
【文章分类号】：TN792
【稿件关键词】：-bit/cycleSARADC内插预放大器交替工作比较器前台校准
【参考文献】:
【稿件标题】：模数转换器芯片|一种具有2-bit/cycle结构的400-MS/s8-bit逐次逼近型模数转换器设计
【作者单位】：复旦大学专用集成电路与系统国家重点实验室;
【发表期刊期数】：《复旦学报(自然科学版)》2014年04期
【期刊简介】：0......更多复旦学报(自然科学版)杂志社(
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【版权所有人】：代国宪；陈迟晓；叶凡；任俊彦；
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